平坦化
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平坦化是半導體制造中使晶圓表面由凹凸變為全域性平整的工藝，核心實現形式是化學機械拋光（CMP）。它把物理研磨和化學腐蝕精密結合，每製作一層電路幾乎都要先做一次平坦化。沒有它，多層佈線無法堆疊，電晶體密度和良率會直接崩盤。在 AI 晶片所依賴的先進邏輯（5 nm/3 nm/2 nm）、高頻寬儲存（HBM）和 2.5D/3D 封裝中，單片晶圓的平坦化步驟已達數十道，是決定晶片能否量產的關鍵基礎技術之一。
3 分鐘產業解釋
晶片是在矽片上一層層”蓋”出來的。每沉積一層介質或金屬，表面都會像梯田一樣高低不平——有凸起的高地和凹陷的溝谷。如果直接在凹凸不平的面上做下一層光刻，焦點對不準，線寬控不住，甚至出現斷線短路。平坦化的任務就是用 CMP 把”梯田”磨成鏡面，實現奈米級的全域性平整度。
在 AI 產業鏈中，平坦化的地位隱蔽但致命：
- 邏輯晶片：5 nm/3 nm 製程的多層銅互連（大馬士革工藝）完全依賴 CMP 去除多餘的銅和阻擋層，形成扁平導線。FinFET/GAA 電晶體的柵極、源漏結構成形也需要多次平坦化。以台積電 N3 為例，公開資料顯示其互連層數超過 15 層，每一層至少對應一道 CMP 步驟。
- 儲存晶片：3D NAND 堆疊已超過 300 層（公開資料顯示，三星、SK 海力士等頭部廠商在 2024-2025 年已推進至 300+ 層），每一層成型前都要 CMP；HBM 的矽通孔（TSV）露出和晶圓減薄同樣離不開平坦化。公開資料顯示，HBM3E 12 層堆疊產品中，單片晶圓約需經歷 4-6 道 TSV 相關 CMP 步驟。
- 先進封裝：CoWoS、InFO 等 2.5D 封裝所用的矽中介層（interposer）上佈滿密集的 RDL 層，其平坦化直接決定晶片互連的可靠性和訊號完整性。3D 混合鍵合（Hybrid Bonding）更要求表面粗糙度達到亞奈米級，這對平坦化工藝提出原子級精度要求。
平坦化的價值已遠超出純製造工序——它直接掛鉤良率、效能與功耗。隨著製程微縮和三維堆疊層數增加，平坦化在總製造成本中的佔比持續上升，在先進製程中已成為不可忽視的流程瓶頸。
技術原理
核心機制
CMP 是化學與機械的協同過程，絕非單純的機械磨削。其原理鏈條可概括為：化學藥劑軟化或鈍化晶圓表面 → 奈米磨粒在壓力下機械移除軟化層 → 露出新鮮表面再次被化學作用。通過動態平衡，實現高移除速率的同時抑制缺陷和損傷。
關鍵引數關係（定性）：
- 移除速率（RR）：近似遵循 Preston 方程——RR ∝ k × P × V，其中 P 為下壓力，V 為晶圓與拋光墊的相對速度，k 為與漿料化學、墊材、溫度等相關的比例常數。先進工藝中，通過調控化學作用可使 k 值大幅變化，Preston 方程僅作為一階近似。
- 選擇比：目標材料移除速率與阻擋層（或介質）移除速率之比，通常需在 50:1 至 100:1 以上[行業基準]，以在介面處自動”停住”，避免過拋。
- 均勻性指標：晶圓內非均勻性（WIWNU，Within-Wafer Non-Uniformity）與晶片內非均勻性（WIDNU，Within-Die Non-Uniformity）。先進邏輯的 WIWNU 通常要求 <3%（1σ）[行業基準，源自裝置商技術白皮書]。混合鍵合應用對均勻性要求更嚴苛。
終點控制：通過監測拋光頭驅動電機的電流/扭矩變化（摩擦係數因層間轉變而突變），或利用光學干涉/渦流感測直接測量膜厚變化，實現對研磨終點的精確停止。先進 CMP 裝置可控制終點停止精度在 10–20 nm 範圍內[基於 Applied Materials 和 Ebara 公開技術資料的折算]，在特定工藝中可達到 5 nm 以內。
平坦化型別（按結構需求）
- 氧化物平坦化：用於淺溝槽隔離（STI）和層間介質（ILD），要求高移除速率和高平整度，選擇性要求相對寬鬆。常用氧化鈰基漿料，因其對 SiO₂ 的高去除速率和自停止特性。
- 金屬平坦化：銅大馬士革工藝的核心。典型流程分三步：粗拋（快速去除大塊銅膜）→ 精拋（停在 Ta/TaN 阻擋層）→ 阻擋層去除與介質過拋補償。嚴重依賴電化學協同控制，要求銅/阻擋層高選擇比，同時抑制銅線凹陷（dishing）和介質侵蝕（erosion）。
- 矽/多晶矽平坦化：用於 FinFET 鰭片成形、GAA 奈米片釋放等結構定義，對錶面缺陷和亞表面損傷極度敏感。
- TSV 露銅拋光：晶圓背面減薄至 <50 μm [量級] 後，通過 CMP 露出嵌入矽中的銅柱，需精密控制矽與銅的速率匹配，避免銅柱凸起（protrusion）或凹陷。
- 混合鍵合表面拋光：對介質層表面粗糙度要求 <0.5 nm RMS[基於行業研討會公開資料的折算]，銅焊盤凹陷控制要求 <5 nm，是目前平坦化精度要求的最高等級。
關鍵引數
平坦化工藝的評價與控制圍繞以下核心引數展開，各引數之間存在複雜的權衡關係——改善某一引數常以惡化另一引數為代價，形成多目標最佳化難題。
| 引數名稱 | 定義 | 先進工藝典型要求 | 說明 |
|---|---|---|---|
| 晶圓內非均勻性（WIWNU） | 全片膜厚標準差/平均厚度 | ≤2–3%（1σ） | 先進邏輯定性基準[裝置商公開資料]，混合鍵合更嚴 |
| 晶片內非均勻性（WIDNU） | 晶片級厚度波動 | ≤1–2%（1σ） | 對邊緣晶片良率影響顯著 |
| 凹陷（Dishing） | 寬金屬線中心低於周圍介質的高度 | <10 nm | 銅互連典型目標[行業公開資料折算] |
| 侵蝕（Erosion） | 密集金屬線陣列中介質損失 | <5 nm | 與線寬/間距比相關 |
| 缺陷密度 | 每片晶圓上大於臨界尺寸（通常 >0.1 μm）的劃傷、顆粒數 | 單顆粒/片水平 | 量產基準[來自裝置商/代工廠公開技術交流資訊] |
| 移除速率（RR） | 每分鐘去除材料厚度 | 氧化物 2000–5000 Å/min，銅 5000–10000 Å/min | 產能直接相關，量級參考[裝置商產品手冊] |
| 選擇比 | 目標材料與次層材料 RR 比 | 50:1 至 >100:1 | 體現工藝視窗寬度 |
| 墊/盤壽命 | 耗材更換週期 | 數百至上千片/墊 | 影響綜合持有成本 |
引數間的核心權衡：
- 提高下壓力可增加移除速率和產能，但會增加劃傷和低 k 介質分層/碎裂風險。
- 提高化學活性可降低機械損傷，但可能擴大凹陷和侵蝕。
- 追求極致均勻性往往以降低整體移除速率為代價，影響裝置產能。
技術路線
在先進半導體制造中，全域性平坦化方案的競爭格局已基本固化。以下對比展示了 CMP 的技術路線主導性。
| 對比維度 | 化學機械拋光（CMP） | 幹法回蝕（Plasma Etchback） | 旋塗平坦化（SOD/SOG） |
|---|---|---|---|
| 平坦化尺度 | 全域性（整片晶圓） | 通常區域性，跟隨底層形貌 | 區域性，受毛細力和收縮限制 |
| 平整度 | 奈米級全域性平面 | 較差，需依賴基底 | 微米級，無法長程平坦 |
| 材料選擇性 | 可調節化學實現高選擇比 | 低，物理/化學刻蝕比例難以精確控制 | 不涉及 |
| 典型應用 | STI、ILD、銅互連、TSV | 定義犧牲層或回蝕形成間隙壁 | 已淘汰或用於低要求鈍化層 |
| 成本與產能 | 裝置與耗材成本高，量產吞吐量已驗證 | 相對低，單獨無法實現全域性平坦 | 低廉，效果有限 |
| 主流性 | 絕對主導，不可替代 | 輔助角色 | 已退出主流應用 |
技術演進方向： 當前未見能系統性替代 CMP 的新技術路線。前沿探索集中在：電化學機械平坦化（ECMP）降低銅拋光下壓力；無磨粒拋光（用化學反應替代機械移除）；雷射輔助平坦化等。公開資料顯示，這些技術均處於學術研究或極早期工程驗證階段，距量產匯入仍有顯著距離。
上游
平坦化產業鏈上游按其核心耗材與元件可拆解為三個細分環節。
拋光液（Slurry）
拋光液是 CMP 的”血液”，由奈米磨料（矽溶膠、氧化鈰、氧化鋁等）、去離子水和功能化學品（氧化劑、絡合劑、緩蝕劑、pH 調節劑、分散劑）復配而成。核心壁壘在於：磨料粒徑分佈需在奈米級精準控制（典型 D50 範圍 20–200 nm，依應用而定）；化學配方需與目標材料體系精確匹配，且需在不同批次間保持高度一致。公開資料顯示，先進銅拋光液涉及 10 餘種組分的複雜配方，開發週期可長達 2–3 年，認證週期 12–18 個月。
拋光墊與修整器
拋光墊通常為多孔聚氨酯材料，需在彈性和硬度之間精確權衡——硬度過高導致劃傷和接觸不均，過軟則平坦化效率低。墊面的微孔結構負責輸送漿料和排出磨屑，其形貌在連續使用中會退化（glazing），需金剛石修整盤定期”修整”以恢復效能。高壽命、高均勻性的拋光墊和修整器建置了顯著的專利壁壘。行業主要供應商包括：DuPont（原 Dow Electronic Materials）、3M、Entegris（整合了 CMC Materials 後形成較完整產品線）、日本 Fujibo 等。
CMP 裝置
CMP 裝置是高度整合的精密系統，含主機臺（拋光頭、拋光碟、下壓力控制系統）、漿料輸送與分佈系統、終點檢測模組、線上清洗單元等。裝置設計的關鍵挑戰在於：多區域壓力控制實現晶片級均勻性最佳化；精確的漿料分佈與溫度管理；高靈敏終點檢測與停機控制。行業主要供應商包括：Applied Materials（全球市場份額據公開行業分析估計約為 60–70%）[SEMI 資料間接展望，Gartner 等公開分析報告估計]，Ebara（日本，在氧化矽/STI 領域強勢），華海清科（中國大陸，已在邏輯、儲存領域實現規模化量產出貨）。
下游
平坦化的下游覆蓋半導體制造的三大核心領域。
邏輯製造
代工廠（台積電、三星、Intel）及 IDM 的 FEOL（前道，STI 形成、柵極定義）、MOL（中道，接觸孔平坦化）、BEOL（後道，每層銅大馬士革互連）各階段均需 CMP。以 5 nm 製程為例，公開資料顯示 FEOL 約需 8–12 道 CMP，BEOL 約需 12–18 道 CMP（視金屬層數而定），先進 FinFET 結構成形另有 4–8 道。合計算來，單片晶圓在邏輯工藝中經歷的 CMP 步驟超過 25 道。GAA（全環繞柵極）節點引入後，奈米片堆疊的釋放和隔離進一步增加步驟數，預計達 30–40 道[基於公開技術論文趨勢推斷]。
儲存製造
DRAM 製造中，電容成形和位線平坦化需多次 CMP。3D NAND 的臺階（staircase）形成、層間堆疊平整化、溝道通孔填充後平坦化等均依賴 CMP。公開資料顯示，200 層以上的 3D NAND 單片約需 15–25 道 CMP 步驟。HBM 需要額外的 TSV 露出和微凸塊平坦化。
先進封裝
台積電 CoWoS 所用矽中介層包含多層 RDL，每層均需 CMP；3M 等廠商介入的臨時鍵合/解鍵合和超薄晶圓減薄後平坦化；Intel EMIB 中矽橋嵌入面的平坦化；以及混合鍵合（Hybrid Bonding）——3D 堆疊的關鍵使能技術——要求 Cu/SiO₂ 表面達到原子級平整，其 CMP 精度要求為全產業鏈最高。
平坦化貫穿從晶圓製造到先進封裝的幾乎每一環節，是當前少有的”製造+封裝”雙輪驅動的工藝環節。
受益公司
以下為公開資料可查證的平坦化產業鏈主要參與方，按業務環節和地域分佈梳理。所有資訊來自公開揭露，不構成任何投資建議。
裝置商
| 公司 | 國別 | 定位與特徵 | 說明 |
|---|---|---|---|
| Applied Materials | 美國 | CMP 裝置全球龍頭 | Reflexion 系列覆蓋金屬/氧化物全應用；據行業分析估算全球份額約 60–70%[SEMI/Gartner 公開資料的趨勢估讀]。2024 財年（截至 2024 年 10 月）半導體系統營收約 196 億美元，CMP 為其配套裝置組合之一[Applied Materials FY2024 年報] |
| Ebara | 日本 | 氧化矽/STI CMP 領域強勢 | 以高穩定性和擁有成本優勢見長，在亞洲儲存廠中廣泛採用 |
| 華海清科 | 中國 | 國產 CMP 裝置龍頭 | 已在邏輯（28 nm–14 nm 節點為主）、3D NAND、先進封裝量產線實現規模出貨。2023 年營收約 27 億元人民幣，2024 年前三季度約 22 億元[華海清科公開財報] |
拋光液/耗材商
| 公司 | 國別 | 定位與特徵 | 說明 |
|---|---|---|---|
| Entegris（含原 CMC Materials） | 美國 | 全球銅 CMP 漿料領先者 | 2022 年收購 CMC Materials 後形成涵蓋漿料、墊、清洗化學品的完整 CMP 耗材組合。2024 年全年營收約 35 億美元（全公司口徑，CMP 為板塊之一）[Entegris 公開財報] |
| Fujimi Incorporated | 日本 | 矽溶膠基漿料龍頭 | 在矽、氧化物拋光液領域技術深厚，長期穩定供應全球頭部代工及儲存廠 |
| Resonac（原昭和電工材料/日立化成） | 日本 | 氧化鈰基漿料強勢 | 2019 年被日立化成剝離，2023 年與昭和電工合併為 Resonac |
| DuPont | 美國 | 拋光墊領先供應商 | IC1000 系列拋光墊為行業經典產品，市場佔有率據行業分析保持高位 |
| 安集科技 | 中國 | 國產 CMP 拋光液核心供應商 | 銅及銅阻擋層拋光液已進入主流代工線；氧化鈰基 STI 拋光液陸續放量。2024 年營收約 16 億元人民幣[安集科技 2024 年度業績快報] |
說明： 上述營收資料取自各公司公開年報、業績快報或官方公告，不同公司財年截止日可能不同，口徑未做統一調整。市場份額資料為行業分析的公開共識估計，無單一官方統計來源。
市場規模
以下資料綜合公開行業分析估算，標註來源型別。
裝置市場
據 SEMI 及 Gartner 公開的裝置市場報告趨勢估讀，全球 CMP 裝置市場規模在 2022–2023 年約為 35–40 億美元，2024 年受儲存市場回暖及先進封裝擴產驅動，估計約為 40–45 億美元（行業估算口徑，非精確統計）。Applied Materials 在整體市場中據主導份額；Ebara 在部分細分市場維持較強存在；華海清科在國內市場快速拓展。
耗材市場
包括拋光液和拋光墊的全球 CMP 耗材市場，據公開行業分析（TECHCET、SEMI 材料市場報告趨勢估讀）估算 2023–2024 年約為 25–35 億美元。拋光液約佔總耗材市場的 60–70%[趨勢比例]，其增長更為穩定——耗用量與全球晶圓出貨量直接相關，但單價隨製程升級而提升。
結構性增長驅動
- 步驟數膨脹：據行業公開分析，28 nm 邏輯單片約 15–20 道 CMP 步驟，5 nm/3 nm 約 25–35 道，GAA 節點預計 30–40 道[行業趨勢估讀，見代工廠公開技術論文]。疊加 3D NAND 從 128 層向 300 層以上的演進和 HBM 的 TSV/混合鍵合新需求，全球 CMP 步驟總量增速持續高於晶圓出貨量增速。
- 高價值漿料佔比提升：混合鍵合用超高精度平坦化漿料、TSV 露銅漿料、鈷/釕互連 CMP 漿料等高附加值品類，其單價顯著高於傳統氧化矽拋光液，帶動耗材市場質量升級。
說明： 因公開統計來源較少細分至”CMP 市場”單一口徑，上述數字為行業估算量級，存在 ±15% 量級的合理偏差。
玩家對比
裝置端對比（公開資料提煉）
| 指標 | Applied Materials | Ebara | 華海清科 |
|---|---|---|---|
| 2024 年 CMP 相關營收估計 | 全公司半導體系統約 196 億美元，CMP 為基本盤之一（具體未單獨拆分）[FY2024 年報] | 未單獨揭露（集團營收約 6,000 億日元，精密機械為其中板塊）[Ebara 公開財報] | CMP 裝置為主營，2024 年營收約 27 億元（含服務）[華海清科公開揭露] |
| 產品覆蓋 | 金屬/氧化物/TSV/先進封裝全場景 | 氧化矽/STI 應用為主力 | 邏輯、3D NAND、先進封裝均有量產出貨 |
| 技術差異化 | 多區域壓力控制、即時輪廓控制；在先進金屬 CMP 領域為行業基準 | 簡單可靠、維護成本低、產能穩定 | 國產替代定位，交期和服務響應速度佔優 |
| 客戶結構 | 全球頭部代工廠、儲存廠 | 亞洲儲存廠為主，部分代工 | 國內邏輯與儲存廠為主，逐步向海外拓展 |
漿料端對比（公開資料提煉）
| 指標 | Entegris（含 CMC） | Fujimi | Resonac | 安集科技 |
|---|---|---|---|---|
| 核心份額 | 銅漿料全球第一（行業共識），阻擋層拋光液強勢 | 矽/氧化物漿料領先 | 氧化鈰基漿料深厚 | 國內銅及阻擋層漿料核心供應商 |
| 2024 年相關營收估計 | CMP 耗材板塊估計在中高個位數億美元量級（全公司約 35 億美元，CMP 為細分板塊） | 精密化學品板塊約數百億日元（具體未單獨拆分）[Fujimi 公開財報] | 未單獨拆分[Resonac 公開揭露] | 約 16 億元人民幣[安集科技 2024 年度業績快報] |
關鍵差異點： 漿料的競爭力不僅在於配方本身，更在於與客戶工藝深度繫結的定製化服務能力。頭部供應商通常與代工廠有 10 年以上的合作歷史，技術護城河既來自配方專利，也來自長期積累的工藝 know-how 和共開發關係。
風險
技術替代風險
目前未見能系統性替代 CMP 的全域性平坦化方案。幹法回蝕、旋塗法、電化學機械平坦化等僅能在特定環節做補充，尚未表現出取代潛力。但是否存在顛覆性新技術路線（如原子層平坦化工藝）值得持續追蹤——雖然公開資料未顯示其已進入工程化階段。
地緣政治與供應鏈風險
CMP 裝置的核心零部件（高精度拋光頭、先進終點檢測模組等）嚴重依賴全球化供應鏈。2023–2024 年以來，美國、日本、荷蘭對華先進半導體裝置出口管制持續強化[公開政策檔案]。華海清科等國產裝置商的供應鏈自主化進度、核心零部件國產化比例提升節奏是關鍵觀察點——但具體進度在公開資料中鮮有定量揭露。
製程微縮帶來的技術挑戰
隨著 GAA 奈米片和互補場效應電晶體（CFET）等新結構引入，低 k 介質進一步脆弱化、新材料（鈷、釕、鉬等）替代銅/鉭互連的潛在趨勢，將導致 CMP 的壓力視窗和化學相容性被進一步壓縮。此外，極紫外光刻（EUV）帶來的 EUV 光刻膠及底層抗反射塗層殘留物的去除，也對 CMP 前清洗提出新要求。這些挑戰在公開技術文獻中已被廣泛討論，但量產解決方案的成熟度尚不明朗。
成本與資本支出週期性
CMP 裝置訂單與全球晶圓廠資本支出高度相關，週期性明顯。2023 年因儲存市場低迷導致 CMP 裝置交付週期延長、新增訂單承壓——這一現象在 Applied Materials 和 Ebara 2023 財年揭露中均有體現[公開財報]。耗材雖相對剛性，但在晶圓廠開工率大幅下行時亦會受到衝擊。
專利與智慧財產權風險
漿料配方是全球頭部供應商的核心壁壘，專利版面配置嚴密。國內廠商在關鍵配方和核心磨料合成技術上仍需依賴部分海外供應或進行規避設計，智慧財產權合規風險值得關注。
誤讀糾偏
❌ “CMP 就是高階的砂紙打磨” ✅ 錯。化學作用佔 CMP 材料移除量的 50% 甚至更多（具體比例因材料體系和工藝引數而異）。純機械研磨會導致不可接受的表面劃傷、亞表面損傷和殘餘應力，只有化學軟化/溶解與機械移除的精細配合，才能實現無損傷的原子級平坦化。
❌ “CMP 只在最終封裝減薄時才用到” ✅ 錯。CMP 貫穿從晶圓到封裝的全程：前道的 STI 形成、柵極和平坦化（FEOL）；中道的接觸孔填充後平坦化（MOL）；後道的每一層銅互連平坦化（BEOL）；以及先進封裝中的 TSV 露出、RDL 平坦化、混合鍵合表面拋光。減薄拋光只是冰山一角。
❌ “平坦化只需要磨平，均勻性要求沒那麼高” ✅ 錯。先進工藝的全域性平坦度差異以奈米計。晶圓邊緣數毫米區域的幾奈米厚度差，即可導致光刻聚焦偏差、接觸孔刻蝕不均和介質擊穿風險顯著上升。對於混合鍵合表面，粗糙度要求 <0.5 nm RMS（行業公開資料折算），超過這一水平將直接影響鍵合強度和電氣連線的可靠性。
❌ “CMP 是成熟工藝，沒什麼技術含量了” ✅ 正好相反。隨著製程向 GAA/CFET 演進、3D NAND 堆疊突破 300 層、混合鍵合進入量產，CMP 面臨的材料多樣性、結構脆弱性、缺陷容忍度挑戰持續升級。這恰恰是平坦化技術與材料創新的最前沿地帶之一。
最新事件
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2024 年半導體裝置出口管制持續收緊：2024 年，美國對華先進半導體裝置出口管制進一步擴大，荷蘭和日本亦出臺相應配套措施[公開政策宣告及新聞報道]。CMP 裝置雖未在管控清單的最核心位置，但先進節點用高精度 CMP 裝置的關鍵零部件供應已受波及。此趨勢下，國產 CMP 裝置進口替代節奏成為產業界焦點。華海清科 2024 年公開揭露顯示，國內邏輯及儲存客戶持續放量，但具體具體制程節點和交付量未詳細揭露。
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混合鍵合量產加速，平坦化成關鍵瓶頸：2024–2025 年，AMD、輝達等 AI 晶片需求驅動下，台積電 CoWoS 產能持續緊張並宣佈大幅擴產[台積電 2024 年公開法說會資訊]。3D 混合鍵合在 HBM 和邏輯-on-logic 堆疊中的應用推進，平坦化被認為是最核心的工藝瓶頸之一——混合鍵合表面的銅凹陷控制和介質全域性平整度要求已達到原子層級極限。Applied Materials 和 Ebara 在 2024 年行業展會（如 SEMICON West、SEMICON Taiwan）上展示的新一代平台，均將混合鍵合平坦化作為突出賣點[公開展訊報道]。
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3D NAND 300 層以上量產競賽：2024–2025 年，三星、SK 海力士和美光均已量產或規劃超過 300 層的 3D NAND 產品[各公司公開宣告及行業報道]。堆疊層數增加直接擴大 CMP 步驟數和高價值氧化矽/多晶矽平坦化漿料的用量需求。
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國產 CMP 漿料進入主流驗證：安集科技 2024 年度業績快報顯示，其在先進製程邏輯和儲存客戶的銅及阻擋層拋光液匯入進展順利，氧化鈰基 STI 拋光液亦實現批量出貨。鼎龍股份等後進入者也在加速拋光液和拋光墊的產品認證。國產化率提升的趨勢已確立，但具體份額數字在公開資料中鮮有揭露。
追蹤指標
| 指標 | 觀測頻率 | 說明與意義 |
|---|---|---|
| 全球晶圓廠資本支出（CAPEX） | 季/年 | 是 CMP 裝置需求的前置指標。資料來源：SEMI、各代工/儲存廠季報 |
| 全球矽晶圓出貨面積 | 季 | CMP 耗材總需求的底層驅動。資料來源：SEMI SMG 季報 |
| 頭部代工廠 N5/N3/GAA 節點晶圓啟動量 | 季 | 反映先進製程 CMP 步驟數增量。來源：台積電/三星季報揭露 |
| HBM/CoWoS 產能及擴產動態 | 季 | TSV 和混合鍵合 CMP 需求的關鍵變數。來源：台積電、SK 海力士、三星公開宣告 |
| 3D NAND 平均層數爬升趨勢 | 年/半年 | 與單片 NAND 的 CMP 步驟數掛鉤。來源：儲存廠技術路線圖揭露 |
| Applied Materials/Ebara/華海清科 CMP 裝置訂單和積壓 | 季 | 直接反映裝置端景氣度。來源：公司季報/年報，需注意華海清科僅揭露營收 |
| Entegris/安集科技 CMP 耗材板塊營收 | 季 | 反映耗材消耗量與價格趨勢。來源：公司季報/年報 |
| 國產 CMP 裝置國產化率 / 漿料自給率 | 年 | 需產業鏈調研或偶爾在券商研究報告和政府規劃中出現 |
| 新漿料配方專利公開數量 | 持續 | 追蹤技術迭代和材料體系變革方向。來源：各國專利資料庫 |
| 關鍵閥門/密封件/終點檢測部件供應動態 | 持續 | 影響裝置交期與產能擴張速度。來源：產業鏈調研 |
說明： 部分指標（如國產化率、特定部件供應動態）在公開市場資料中不易獲取，需要專題調研或訂閱行業資料服務（如 SEMI Market Data、Gartner Semiconductor Forecast、各家賣方研究報告資料庫）。
信源
- 行業資料與報告：SEMI World Fab Forecast、SEMI Materials Market Data Subscription、Gartner Semiconductor Market Analysis、TECHCET CMP Consumables Report（均為付費服務，公開渠道僅能獲取摘要或趨勢性引述）。
- 學術與技術文獻：IBM Journal of Research and Development 銅 CMP 早期奠基論文（如 1998 年關於銅大馬士革 CMP 的專題系列）；ECS Journal of Solid State Science and Technology 中的 CMP 專輯；IEEE Transactions on Semiconductor Manufacturing；MRS Bulletin 平坦化綜述文章。以上為需通過學術資料庫獲取的期刊。
- 公司公開揭露與投資者資料：Applied Materials 年度財報與投資者簡報（可通過其官網 Investor Relations 獲取）；Ebara 集團年度報告；華海清科招股說明書、年度報告、業績快報與投資者調研紀要；安集科技招股說明書、年度報告、業績快報；Entegris 年度財報與投資者展示（SEC EDGAR 系統可查）；台積電季度法人說明會材料與年報。
- 新聞與深度報道：SemiEngineering（關於 CMP 技術挑戰與趨勢的系統性報道）；DigiTimes（產業鏈動態追蹤）；Nikkei Asia；中國電子報、半導體行業觀察等中文專業平台。
- 行業展會與技術論壇：SEMICON West 和 SEMICON Taiwan 中 CMP 相關技術論壇與展商演示（可通過 SEMI 官網瀏覽往屆議程和部分公開幻燈片）；ICP（International Conference on Planarization/CMP Technology）會議論文集。
宣告： 本文所有財務、市場、份額、產能數字均已標註來源型別和年份口徑。標有”行業估計""定性估計""趨勢估讀”的資料非精確統計數字，僅反映量級和方向。對於無法在公開資料中查證的定量資料，已註明”公開資料未見”。本文不構成任何投資建議、買賣推薦或趨勢預測。